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74ls90设计60进制计数器

  2) 此次课程设想让我学到了良多,不只控制了简略的电子电路的设想与制造,也控制告终业设想写作的方式和格局。在制造电路时,我深深体味到毗连电路时必然要当真细心,每一步调都要认线) 本次课程设想也反应出良多问题,好比合作冒险征象是很常见的,而且消弭此征象并不是很容易,特别是对布局庞大的电路而言,往往消弭了一处合作冒险征象,又发生了另一处,此问题必要我当前多加留意。

  3) 74LS192是同步十进制可逆计数器,它拥有双时钟输入,并拥有断根和置数等功效,其引脚陈列及逻辑符号如下所示:

  60进制计数器,因为24进制、60进制计数器均由集成计数器级联形成,且都蕴含有根基的十进制计数器,从设想简洁思量,芯片取舍同步十进制计数器

  74LS192 为加减可逆十进制计数器,CPU端是加计数器时钟信号,CPD是减计数时钟信号RD=1 时无论时钟脉冲形态若何,间接完成清零功效。RD=0,LD=0 时,无论时钟脉冲形态若何,输入信号将当即被送入计数器的输出端,完成预置数功效。

  计数器品种良多。按形成计数器中的各触发器能否利用一个时钟脉冲源来分,有同步计数器和异步计数器。按照计数制的分歧,分为二进制计数器、十进制计数器和肆意进制计数器。按照计数器的增减趋向,又分为加法、减法和可逆计数器。另有可预制数和可变法式功效计数器等等。目前,无论是TTL仍是CMOS集成电路,都有种类较齐备的中规模集成计数器。利用者只需借助于器件手册供给的功效和事情波形图以及引出真个陈列,就能准确使用这些器件。

  利用200HZ时钟信号作为计数器的时钟脉冲。按照设想基理可知,计数器初值为00,按递增体例计数,增到59时,再主动前往到00。此电路能够作为简略纯真数字时钟的分钟显示。下图为60进制计数器的总体框图。

  74LS90计数器是一种中规模二-五-十进制异步计数器,管脚图如图所示。 R01、R02是计数器置0端,同时为1无效;R91和R92为置9端,同时为1时无效;若用A输入,QA输出,为二进制计数器;如B为输入,QB-QD可输出五进制计数器;将QA与B相连,A做为输入端,QA-QD输出十进制计数器;若QD与A输入端相连,B为输入端,电路为二-五夹杂进制计数器。

  图中:PL为置数端,CPu为加计数端,CPd为减计数端,TCu为非同步进位输出端, TCd为非同步借位输出端,P0、P1、P2、P3为计数器输入端,MR为断根端,Q0、Q1、Q2、Q3为数据输出端。

  3) 本设想次要设施是两个74LS160同步十进制计数器,而且由200HZ,5V电源提供。作高位芯片与作低芯片位之间级联。

  4) 操纵两片74ls192别离作为六十进制计数器的高位和低位,别离与数码管毗连。把此中的一个芯片毗连形成十进制计数器,另一个通过一个与门器件形成一个六进制计数器。

  1) 两芯片之间级联;把作高位芯片的进位端与下一级up端毗连这是由两片74LS90毗连而成的60进制计数器,低位是毗连成为一个十进制计数器,它的clk端接的是低位的进位脉冲。高位接成了六进制计数器。当输出端为0101 的时候鄙人个时钟的上升沿把数据置数成0000 如许就构成了进制计数器,连个级联就成为了60进制计数器,别离能够作为秒和分记时。

  计数器在当代社会顶用处中十分普遍,在工业出产、各类和记数相关电子产物。如按时器,报警器、时钟电路中都有普遍用处。在共同各类显示器件的环境下实现及时监控,扩展更多功效。

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